XC9572XL-10TQG100i XILINX高性能CPLD（复杂可编程逻辑器件,Complex Programmable Logic Device ）
2024-03-20 18:56:17
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XC9572XL-10TQ100I特性
● 5 ns引脚到引脚的逻辑延迟
● 系统频率高达178 MHz
● 72个宏细胞，1600个可用门
● 采用小尺寸封装
- 44引脚PLCC(34个用户I/O引脚)
- 44引脚VQFP(34个用户I/O引脚)
- 48针CSP(38个用户I/O引脚)
- 64引脚VQFP(52个用户I/O引脚)
- 100引脚TQFP(72用户I/O引脚)
-所有包均可免费使用
● 针对高性能3.3V系统优化
-低功耗运行
- 5V容错I/O引脚接受5V, 3.3V和2.5V信号
- 3.3V或2.5V输出能力
-先进的0.35微米特征尺寸CMOS Fast FLASH?技术
● 先进的系统功能
- 系统内可编程
- 卓越的引脚锁定和可达性与快速连接?开关矩阵
- 额外宽54输入功能块
- 每个宏细胞最多90个产品条款，并具有单独的产品条款分配
- 本地时钟反转与三个全局和一个产品期限时钟
- 单个输出使能每个输出引脚
- 所有用户和边界扫描引脚输入的输入迟滞
- 所有用户引脚输入上的总线保持电路
- 全IEEE标准1149.1边界扫描(JTAG)
● 快速并发编程
● 单个输出的转换率控制
● 增强的数据安全功能
● 优良的质量和可靠性
- 持久性超过10,000个程序/擦除周期
- 数据保留20年
- 2000v以上的ESD保护
● 引脚兼容44引脚PLCC封装和100引脚TQFP封装的5v核XC9572器件
警告:编程温度范围为0°C至+70°C
XC9572XL-10TQ100I描述
XC9572XL是一款3.3V CPLD（复杂可编程逻辑器件=Complex Programmable Logic Device），适用于前沿通信和计算系统中的高性能、低压应用。它由四个54V18功能块组成，提供1,600个可用门，传播延迟为5 ns。请参见图2了解概述。
XC9572XL-10TQ100I功率估计
CPLS的功耗可以根据系统频率、设计应用和输出而有很大的不同装载。为了帮助降低功耗，XC9500XL设备中的每个宏单元都可以配置为低功耗模式(默认为高性能模式)。此外，未使用的产品术语和宏单元格是自动的被软件停用以进一步节省电力。
对于ICC的一般估计，可以使用以下公式:
Icc(mA) = MChs(0.175*PThs + 0.345) + MClp(0.052*PTlp + 0.272) + 0.04 * MCTOG(MChs + MClp)* f
where:
高速配置中的MChs = # macrocells
PThs =每个宏细胞的高速产物项的平均数目
MClp = # macrocells在低功耗配置
PTlp =每个macrocell的平均低功耗产品项数
F =最大时钟频率
MCTOG =每个时钟切换触发器的平均百分比(~12%)
该计算来自于对装有16位计数器和允许的XC9500XL部件的实验室测量,要启用单个输出(LSB)。实际的ICC值随设计应用而变化，在系统正常运行时发现,应该是正确的,。图1以图形形式显示了上述估计。有关该设备功耗的更详细讨论，请参见Xilinx
以上所有图片均为实物拍摄后抠图后即上线展示，所见即所得。
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